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[Data of Report]

Report Number:
TR0322
Date of Registration:
1987.11
English Title:
Parallel Cashe Mechanism Optimized for KL1 Memory access characteristics
Japanese Title:
KL1のメモリ参照特性に適した並列キャッシュ機構
English Author:
A.Matsumoto,T.Nakagawa,M.Sato,Y.Kimura,K.Nishida,A.Goto
Japanese:
松本　明,中川　貴之,佐藤　正俊,木村　康則,西田　健次,後藤　厚宏
Name of Organization to which author belongs:
ICOT,ICOT,ICOT,ICOT,ICOT,ICOT
PDF:
tr0322.pdf

[Contents]

1はじめに.... 2
2並列キャッシュ機構.... 2
2.1並列キャッシュ機構設計のポイント.... 2
2.25状態並列キャッシュ.... 3
2.3メモリ操作用のCPUコマンド.... 3
2.4メモリ操作用のパスコマンドと応答.... 4
2.55状態並列キャッシュの状態遷移.... 4
3ロック機構.... 4
3.1ロック機構設計のポイント.... 4
3.2ロックディレクトリの状態.... 4
3.3ロック操作用のCPUコマンド.... 4
3.4ロック操作用のバスコマンドと応答.... 4
4評価.... 6
4.1評価方法.... 6
4.2並列キャッシュの構成.... 6
4.3評価プログラムの特性.... 6
5KL1のメモリ参照特性の評価.... 6
5.1名目バス使用率とキャッシュ・ミスヒット率.... 6
5.2キャッシュ容量と名目バス使用率.... 7
5.3各領域毎のメモリ参照特性.... 7
5.4キャッシュ構成と台数効果.... 8
5.5RBコマンドの効果.... 8
5.6実行終了後のキャッシュ状態の分析.... 9
6おわりに.... 9
参考文献.... 9

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